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采样频率的高低对系统参数辨识精度有何影响

发布时间:2019-09-05 19:55 来源:未知 编辑:admin

  大规模、超大规模可编程逻辑器件与EDA(Elatronic Design Autiomation 电子设计自动化)技术已经成为现代数字技术发展的潮流,20世纪90年代,集成电路产业销售额增长最快的产业是现场可编程逻辑集成电路。HDL非常适用于可编程逻辑器件的应用设计。尤其在大容量CPLD和FPGA的应用设计中,若采用以往的布尔方程或门级描述方式,很难快速有效地完成。VHDL 能提供高级语言结构,方便地描述大型电路,快速地完成设计。它支持设计单元库的创建,以存储设计中重复使用的元件。它是一种标准语言,它的设计描述可被不同的工具所支持,可用不同器件来实现。

  VHDL语言的设计方法是一种高层次的设计方法,也称为系统级的设计方法,其设计步骤如下:

  (4) 用综合器对VHDL源代码进行综合优化处理,生成门级描述的网表文件。

  利用适配器产生的器件编成文件通过编程器或下载电缆到目标芯片FPGA和CPLD中。

  数字电子密码锁主要由三部分组成:键盘接口电路、电子密码锁的控制电路、输出七段显示电路、再辅助相应的外围电路就可实现完整的电子密码锁功能.

  这次的设计主要是设计电子密码锁的控制电路、输出七段显示电路、再辅助相应的外围电路,由于键盘接口电路较为复杂,我只能简单的设计一些思路。

  本数字电子密码锁使用的电源为正5V直流电,使用的原始时钟频率为4MHz。它具有下述功能:

  数码输入:每按下一个数字键,就输入一个数值,并在显示器上的最右方显示出该数值,并将先前己经输入的数据依序左移一个数字位置。

  解除密码:按下此键时会将当前的解锁码与所设密码进行比较,如果一致可得相应的开锁信号。

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